hdLab ：購入申込書(ESA・トレーニング)

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お申込・お支払いの詳細につきましては、ESA・トレーニング受講（受験）申込規約をご覧下さい。

受講（受験）希望日

申込	講座名	日程	期間	価格 (税込)
終了	Verilog HDLセミナー (RTL設計中級論理合成)	19/2/21(木)～2/22(金) 10:00～18:00	2日間	￥105,840
中止	専門分野 (設計スタイルガイドセミナー・Verilog HDL版)	19/2/26(火)～2/27(水) 10:00～18:00	2日間	￥105,840
	Verilog HDLセミナー (RTL設計初級)	19/3/13(水)～3/15(金) 10:00～18:00	3日間	￥158,760
	組込み分野 (組込みC言語入門)	19/3/19(火)～3/20(水) 10:00～18:00	2日間	￥105,840
	Verilog HDLセミナー (RTL設計中級機能検証)	19/3/28(木)～3/29(金) 10:00～18:00	2日間	￥105,840
--	SystemCセミナー (入門コース)	10:00～18:00	2日間	￥105,840
--	SystemCセミナー (TLM入門コース)	10:00～18:00	1日間	￥52,920
--	SystemCセミナー (TLM実践コース)	10:00～18:00	1日間	￥52,920
--	SystemVerilogセミナー (入門コース)	10:00～18:00	2日間	￥105,840
--	SystemVerilogセミナー (アサーションコース)	10:00～18:00	2日間	￥105,840
--	Verilog HDLセミナー (論理回路基礎)	10:00～18:00	2日間	￥105,840
--	Verilog HDLセミナー (RTL設計上級機能検証)	10:00～18:00	2日間	￥105,840
--	Verilog HDLセミナー (RTL設計上級論理合成)	10:00～18:00	2日間	￥105,840
--	フレッシュマンセミナー (RTL設計初級実機演習講座)	10:00～18:00	3日間	￥158,760
--	専門分野 (設計スタイルガイドセミナー・VHDL版)	10:00～18:00	2日間	￥105,840
--	専門分野 (RTL設計初級 VHDL)	10:00～18:00	3日間	￥158,760
--	専門分野 (検証スクリプト講座)	10:00～18:00	1日間	￥52,920
--	専門分野 (システム設計概論)	10:00～18:00	2日間	￥105,840
--	専門分野 (新しい検証技術講座)	10:00～18:00	1日間	￥52,920
--	組込み分野 (Linux初級講座)	10:00～18:00	1日間	￥27,000
--	組込み分野 (MPU基礎)	10:00～18:00	1日間	￥52,920
--	組込み分野 (ハードウェア基礎)	10:00～18:00	2日間	￥105,840

受講（受験）者

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申し込み責任者（個人で申し込まれる場合は、入力の必要はありません）

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