購入申込書(ESA・トレーニング)

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お申込・お支払いの詳細につきましては、ESA・トレーニング受講(受験)申込規約をご覧下さい。

受講(受験)希望日

申込講座名日程期間価格
(税込)
SystemVerilogセミナー
(アサーションコース)
20/1/30(木)~1/31(金)
10:00~18:00
2日間¥107,800
Verilog HDLセミナー
(RTL設計中級 論理合成)
20/2/4(火)~2/5(水)
10:00~18:00
2日間¥107,800
Verilog HDLセミナー
(RTL設計上級 機能検証)
20/2/13(木)~2/14(金)
10:00~18:00
2日間¥107,800
専門分野
(設計スタイルガイドセミナー・Verilog HDL版)
20/2/18(火)~2/19(水)
10:00~18:00
2日間¥107,800
専門分野
(RTL設計初級 VHDL)
20/2/26(水)~2/28(金)
10:00~18:00
3日間¥161,700
組込み分野
(組込みC言語入門)
20/3/2(月)~3/3(火)
10:00~18:00
2日間¥107,800
SystemCセミナー
(入門コース)
20/3/4(水)~3/5(木)
10:00~18:00
2日間¥107,800
Verilog HDLセミナー
(RTL設計中級 機能検証)
20/3/12(木)~3/13(金)
10:00~18:00
2日間¥107,800
SystemVerilogセミナー
(入門コース)
20/3/16(月)~3/17(火)
10:00~18:00
2日間¥107,800
Verilog HDLセミナー
(RTL設計初級)
20/3/25(水)~3/27(金)
10:00~18:00
3日間¥161,700
--SystemCセミナー
(TLM入門コース)
 
10:00~18:00
1日間¥53,900
--SystemCセミナー
(TLM実践コース)
 
10:00~18:00
1日間¥53,900
--Verilog HDLセミナー
(論理回路基礎)
 
10:00~18:00
2日間¥107,800
--フレッシュマンセミナー
(RTL設計初級 実機演習講座)
 
10:00~18:00
3日間¥161,700
--専門分野
(設計スタイルガイドセミナー・VHDL版)
 
10:00~18:00
2日間¥107,800
--専門分野
(検証スクリプト講座)
 
10:00~18:00
1日間¥53,900
--専門分野
(システム設計概論)
 
10:00~18:00
2日間¥107,800
--専門分野
(新しい検証技術講座)
 
10:00~18:00
1日間¥53,900
--組込み分野
(Linux初級講座)
 
10:00~18:00
1日間¥27,500
--組込み分野
(MPU基礎)
 
10:00~18:00
1日間¥53,900
--組込み分野
(ハードウェア基礎)
 
10:00~18:00
2日間¥107,800

受講(受験)者

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申し込み責任者(個人で申し込まれる場合は、入力の必要はありません)

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(受講者と住所が異なる場合のみ)
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FAX番号
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