hdLab ：購入申込書(ESA・トレーニング)

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お申込・お支払いの詳細につきましては、ESA・トレーニング受講（受験）申込規約をご覧下さい。

受講（受験）希望日

申込	講座名	日程	期間	価格 (税込)
error	Verilog HDLセミナー (RTL設計初級)	20/9/28(月)～9/30(水) 10:00～18:00	3日間	￥161,700
	組込み分野 (MPU基礎)	20/10/9(金)～10/9(金) 10:00～18:00	1日間	￥53,900
	SystemCセミナー (入門コース)	20/10/20(火)～10/21(水) 10:00～18:00	2日間	￥107,800
	専門分野 (設計スタイルガイドセミナー・Verilog HDL版）	20/10/27(火)～10/28(水) 10:00～18:00	2日間	￥107,800
	専門分野 (検証スクリプト講座)	20/11/13(金)～11/13(金) 10:00～18:00	1日間	￥53,900
	専門分野 (RTL設計初級 VHDL)	20/11/18(水)～11/20(金) 10:00～18:00	3日間	￥161,700
--	SystemCセミナー (TLM入門コース)	10:00～18:00	1日間	￥53,900
--	SystemCセミナー (TLM実践コース)	10:00～18:00	1日間	￥53,900
--	SystemVerilogセミナー (入門コース)	10:00～18:00	2日間	￥107,800
--	SystemVerilogセミナー (アサーションコース)	10:00～18:00	2日間	￥107,800
--	Verilog HDLセミナー (論理回路基礎)	10:00～18:00	2日間	￥107,800
--	Verilog HDLセミナー (RTL設計中級機能検証)	10:00～18:00	2日間	￥107,800
--	Verilog HDLセミナー (RTL設計中級論理合成)	10:00～18:00	2日間	￥107,800
--	Verilog HDLセミナー (RTL設計上級機能検証)	10:00～18:00	2日間	￥107,800
--	フレッシュマンセミナー (RTL設計初級実機演習講座)	10:00～18:00	3日間	￥161,700
--	専門分野 (設計スタイルガイドセミナー・VHDL版)	10:00～18:00	2日間	￥107,800
--	専門分野 (システム設計概論)	10:00～18:00	2日間	￥107,800
--	専門分野 (新しい検証技術講座)	10:00～18:00	1日間	￥53,900
--	組込み分野 (Linux初級講座)	10:00～18:00	1日間	￥27,500
--	組込み分野 (ハードウェア基礎)	10:00～18:00	2日間	￥107,800
--	組込み分野 (組込みC言語入門)	10:00～18:00	2日間	￥107,800

受講（受験）者

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アンケート*	この製品（セミナー）を何で知りましたか？
その他	ご要望などありましたら、こちらにご記入ください。

申し込み責任者（個人で申し込まれる場合は、入力の必要はありません）

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