トレーニングスケジュール

現在弊社で予定しているトレーニングのスケジュールと申込受付状況一覧です。
尚、お申込の際は「受付中」をクリックし、ご希望の講座名にチェックを入れ、必要事項をご入力の上、
お申込ください。

講座名日程期間状況
SystemCセミナー
(TLM入門コース)
12/2/15(水)~2/15(水)
10:00~18:00
1日間受付中
SystemCセミナー
(TLM実践コース)
12/2/16(木)~2/16(木)
10:00~18:00
1日間受付中
SystemCセミナー
(TLM発展コース)
12/2/17(金)~2/17(金)
10:00~18:00
1日間受付中
Verilog HDLセミナー
(RTL設計初級)
12/2/20(月)~2/22(水)
10:00~18:00
3日間受付中
Verilog HDLセミナー
(RTL設計中級 機能検証)
12/2/27(月)~2/28(火)
10:00~18:00
2日間受付中
専門分野
(設計スタイルガイドセミナー)
12/3/5(月)~3/5(月)
13:30~17:30
0.5日間受付中
専門分野
Verilog-AMS beginners' course
12/3/6(火)~3/7(水)
10:00~17:00
2日間受付中
SystemVerilogセミナー
(入門コース)
12/3/12(月)~3/13(火)
10:00~18:00
2日間受付中
専門分野
検証スキル向上セミナー
12/3/14(水)~3/14(水)
10:00~18:00
1日間受付中
SystemVerilogセミナー
(アサーションコース)
12/3/15(木)~3/16(金)
10:00~18:00
2日間受付中
Verilog HDLセミナー
(RTL設計上級 機能検証)
12/3/21(水)~3/22(木)
10:00~18:00
2日間受付中
SystemCセミナー
(入門コース)
12/4/9(月)~4/10(火)
10:00~18:00
2日間受付中
専門分野
新しい検証技術講座
12/4/12(木)~4/12(木)
10:00~18:00
1日間受付中
SystemVerilogセミナー
(入門コース)
12/4/16(月)~4/17(火)
10:00~18:00
2日間受付中
組込み分野
(Linux初級)
12/4/18(水)~4/18(水)
10:00~18:00
1日間受付中
組込み分野
(ハードウェア基礎)
12/4/19(木)~4/20(金)
10:00~18:00
2日間受付中
Verilog HDLセミナー
(RTL設計初級)
12/4/23(月)~4/25(水)
10:00~18:00
3日間受付中
専門分野
検証スクリプト講座
12/4/27(金)~4/27(金)
13:30~17:30
0.5日間受付中
Verilog HDLセミナー
(論理回路基礎)
 
10:00~18:00
2日間 
Verilog HDLセミナー
(RTL設計中級 論理合成)
 
10:00~18:00
2日間 
Verilog HDLセミナー
(RTL設計上級 論理合成)
 
10:00~18:00
2日間 
フレッシュマンセミナー
(RTL設計初級 実機演習講座)
 
10:00~18:00
3日間 
組込み分野
(MPU基礎)
 
10:00~18:00
1日間 
組込み分野
(組込みC言語入門)
 
10:00~18:00
2日間 
専門分野
システム設計概論
 
10:00~18:00
2日間 
専門分野
USB規格とUVC規格 初級講座
 
10:00~17:30
1日間 
専門分野
Spice beginners' course
 
10:00~17:30
1日間 
専門分野
Spice Intermediate course
 
10:00~17:30
1日間 
専門分野  Power Integrity/
Signal Integrity Simulation 基礎講座
 
10:00~17:30
1日間 
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