現在弊社で予定しているトレーニングのスケジュールと申込受付状況一覧です。
お申込の際は「受付中」をクリックし、ご希望の講座名にチェックを入れ、必要事項をご入力の上、
お申込ください。
尚、ご希望講座の開催予定がない場合、又は下記開催日程以外での開催をご希望される場合は、
トレーニング開催リクエストよりお申込ください。
講座名 | 日程 | 期間 | 状況 |
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Verilog HDLセミナー (RTL設計中級 論理合成) | 21/2/18(木)~2/19(金) 10:00~18:00 | 2日間 | 終 了 |
組込み分野 (Linux初級講座) | 21/3/8(月)~3/8(月) 10:00~18:00 | 1日間 | 受付中 |
フレッシュマンセミナー (RTL設計初級 実機演習講座) | 21/3/15(月)~3/17(水) 10:00~18:00 | 3日間 | 中 止 |
Verilog HDLセミナー (RTL設計初級) | 21/3/24(水)~3/26(金) 10:00~18:00 | 3日間 | 受付中 |
Verilog HDLセミナー (RTL設計中級 機能検証) | 21/3/30(火)~3/31(水) 10:00~18:00 | 2日間 | 受付中 |
SystemVerilogセミナー (入門コース) | 21/4/6(火)~4/7(水) 10:00~18:00 | 2日間 | 受付中 |
SystemVerilogセミナー (アサーションコース) | 21/4/13(火)~4/14(水) 10:00~18:00 | 2日間 | 受付中 |
Verilog HDLセミナー (論理回路基礎) ※オンライン開催※ | 21/4/20(火)~4/21(水) 10:00~18:00 | 2日間 | 受付中 |
SystemCセミナー (入門コース) | 10:00~18:00 | 2日間 | |
SystemCセミナー (TLM入門コース) | 10:00~18:00 | 1日間 | |
SystemCセミナー (TLM実践コース) | 10:00~18:00 | 1日間 | |
Verilog HDLセミナー (RTL設計上級 機能検証) | 10:00~18:00 | 2日間 | |
専門分野 (設計スタイルガイドセミナー・Verilog HDL版) | 10:00~18:00 | 2日間 | |
専門分野 (設計スタイルガイドセミナー・VHDL版) | 10:00~18:00 | 2日間 | |
専門分野 (RTL設計初級 VHDL) | 10:00~18:00 | 3日間 | |
専門分野 (検証スクリプト講座) | 10:00~18:00 | 1日間 | |
専門分野 (システム設計概論) | 10:00~18:00 | 2日間 | |
専門分野 (新しい検証技術講座) | 10:00~18:00 | 1日間 | |
組込み分野 (MPU基礎) | 10:00~18:00 | 1日間 | |
組込み分野 (ハードウェア基礎) | 10:00~18:00 | 2日間 | |
組込み分野 (組込みC言語入門) | 10:00~18:00 | 2日間 |